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R
Detailed Description
A differential clock output from the FPGA is driven out through a second pair of SMA
connectors. This allows the FPGA to drive a precision clock to an external device such as a
piece of test equipment. Table 1-3 summarizes the differential SMA clock pin connections.
Table 1-3:
Differential SMA Clock Connections
ML501 Evaluation Platform
UG226 (v1.4) August 24, 2009
Label
J10
J11
J12
J13
Clock Name
SMA_DIFF_CLK_IN_N
SMA_DIFF_CLK_IN_P
SMA_DIFF_CLK_OUT_N
SMA_DIFF_CLK_OUT_P
www.xilinx.com
FPGA Pin
F10
F9
F19
E18
17
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